【Verilog】 記述言語で論理設計Project15 【VHDL】 [無断転載禁止]©2ch.net
HDLの処理系も、それを実際に動かすシミュレータ・評価基板も、
安価で入手できるようになってきました。
このスレが目に入ったお嬢さん! HDLで何か作って遊んでみませんか。
日曜工作のHDL書き、学生さん、プロの方、主婦の方、カキコお待ちしております。
関連情報は >2-10 あたり。
入れ食いキーワード
・Nios、MicroBraze
・Artix-7、Kintex-7、Virtex-7、ハードコアCPU内蔵 Zynq-7000
※前スレ
【Verilog】 記述言語で論理設計Project14 【VHDL】
http://rio2016.2ch.net/test/read.cgi/denki/1470611688/ ぼきゅVHDLとう゛ぇりろぐを、IP化してうるわ
おまえら1デバイスあたり千円払うなら使わせてやるで >>87
＞不正脈出るくらいの職場
組織ぐるみで不正を行っているってこと？ >>92
AV1 エンコーダ頼む。
3000円払うわ。 >>98
設計者の好み（というか得意不得意という面）が一番大きいんじゃない？
DRAMの制御回路（マルチポート化ロジック）なんかでも
バッファをSRAMにするかDFF（シフトレジスタ）にするか、
俺の周りでは設計する人によって２つの派に割れる サイズと速度だな
16Byte程度以下ならゲート、それを超えるとROM/RAMを候補に ROM/RAM 使ったら BIST が面倒くさいだろ。
仮レイアウト前にサイズも決めないといけないし。 質問お願いします。
XILINXのARTIX7を使ってみようと考えていますが、使う前にデータシートを読んでいます。
ピンの使い方は何となく分かるのですが、ROMから書き込みがいまいちわかりません。
INIT_B と PROGRAM_B は、何か違うのでしょうか?
使い方がイメージできずに困っています。
マイコンで言うMCLRピンは、どれになるのでしょうか? >>104
ザイリンクスノ代理店に問い合わせてね
ｗｗｗｗ >>104
データシートより7 Series FPGAs Configuration User Guide読め
古いバージョンなら日本語版もある ユニークで個性的な確実稼げるガイダンス
暇な人は見てみるといいかもしれません
グーグルで検索するといいかも『ネットで稼ぐ方法 モニアレフヌノ』
TCKKJ >>106
ありがとうございます。
コンフィグだけで取説があるんですか？
本体データーシートも入れると、皆さん1000ページ以上も読んでいるんですか？
_bの意味がやっとわかりました。反転論理の意味ですね。
n○○のほうがわかりやすい。 FPGAで何がしたいのかわからんけど、まずは評価ボードを買って動かしてみる方がいいんじゃね？ データシート、アプノートは
さらーっと必要なところ読むんよ
日本語版は時々古くて嘘書いてあるから
重要なところは最新英語版を当たること FPGA使った回路設計するなら、データシート・アプリケーションノート読むのも
大事だけど、評価ボードの回路図参考にするのは必須
あと、コンフィグ関係のピンをユーザーI/Oピンと共用するようなことは
事前に試して確認できないかぎりやらないこと >>114
評価ボードの回路図、参考はいいけど鵜呑みはイカン
内容理解して確認した上で設計しないと
市販品にもバグはある FPGA評価ボードで魔方陣の全解計算は出来ますか？ >>116
サイズとか時間制約とか分からんけど
チューリング完全なら出来るんだろ、きっと。 FPGAにCPU載せられるんだから、できるかできないかで言えば、できる。 多分、5x5より大きな魔方陣の解の厳密な数は求まってない。
本質的に異なる解の数は、
5x5の時に275,305,224個。
6x6だと2*10^19ぐらいと見積もられている。
このサイズは時間的に無理だね。 >>121
たぶんそれはCPUでALU1個での見積もりですよね。
ALU１００個で一斉チェックしたら加速度的に早くならないかな。 >121 の説明が正しいとすれば
2*10^19 -> 2*10^17、になるだけじゃないの？
誤差のうちだな 123 の言うとおり。
勘違いしないように言っとくと、チェックするもの全てが解になるわけじゃない。
5x5の場合、解数は2億個程度だけど、しらみつぶしに調べたら25!(=約1.5*10^25)個をチェックするはめになる。
スパコン京は、ALUが70万個ぐらいあるけど、このままじゃ全く歯が立たない。
まして100ALUなんてゴミ。
やってみりゃわかるけど、5x5だってかなり努力しないと数えられないよ。 >>116
＞FPGA評価ボードで魔方陣の全解計算は出来ますか？
出来るといくらくれるの？ アルゴリズムを固めるのが先
PC上のソフトでそれ組めないやつがFPGA上で実装できるとは思えない CPU上のソフトをFPGAでハード実装すると速くなると幻想してる勘違いさんへ。
アプリにもよるが、単純に速度比較するとほとんどの場合FPGA実装はPC上のソフトより遅い。
ハード固有の最適化などを駆使してやっと、速くなることがあるようなもの。
CPUはコア数多いし、圧倒的にクロックが速い。 CPUは→最近のCPUは
fpgaで一桁以上速くできるのはかなりレア。 まっとうな事いってるな
FPGAの速度は、昨今のCPUに比べて おおよそ 1/10
実際やてみれば直ぐわかることだが、意味のある回路を動かそうとしたら 400MHz 程度でもかなり厳しい
速度は1/10だが、例えば 並列で動かせる演算器は 100倍
結果、うまく使えば、10 倍速くできる
そんな風な使い方しないとメリット出せない
ようは、並列度を上げられないような事象以外へ適応しても 効果は期待できない
残念ながら、自然界ではそういう事が多いからな >>133
ウンコ好きなの？3トンぐらい置いておくね 何で、リクナビで「QuEST Global Services Pte. Ltd.」という派遣会社を通じて、ソニー半導体で働く人を募集しているの？ >>135
著しい中小企業レベルの待遇で、最高収益を上げたソニー半導体企業で奴隷のように働かせる差別的待遇を、同一労働同一賃金の観点から説明をソニー社員の方から文書で頂かないと働きません。他をあたってください >>136
朝から5ｃｈで、オレ様を正社員で採用せず、派遣で格安の給与で採用しようとするソニーという企業に一人労働闘争を5ｃｈでするだけの簡単なお仕事。 wire aに入ってる値をreg bに代入する方法ってないですか？ >>2にVerilogシミュレータがあるのにVHDLシミュレータがないのはなぜでしょうか？ 誰も書かなかったからじゃない?
model SIM逝っとけとか思ってる人多い
iverilogに比べて何故か?GHDLはメジャーじゃない気はする FreeHDLを使ってみているのですが、いまいち期待通りに動きません
VHDLを複数ファイルに分割すると、ここ↓と同じエラーが出ます
http://d.hatena.ne.jp/miyox/20061109
しかもコンパイル手順を直しても改善しません
私の環境のディレクトリ構成が悪いのかなと試行錯誤しているところです
GHDLの方が使いやすいでしょうか？ >2 の ・FPGA
に出てるFPGAベンダで、Free板の"modelsim"も提供してるとこが有るんだから それ使えって
皆そう思ってるでしょ
（無料）って書いてないから有料しかないと思ったのかな？ ハードウェア記述言語ってなんか
アンドロMDAに似てるな >>145
アンドロゲン依存性前立腺癌細胞株(MDA −PCa−2b) なんて難しいことを知ってるな！ Free板modelsim、
xilinxは止めちゃった
残ってるのはalteraだっけ?
あとmicrosemiか
他にある?
つーか、modelsim自体がなんだかよくわかんね
シエスタ?だかそんな名前の奴に統合予定? >>144
ありがとうございます、試してみます
Icarus Verilogみたいに軽いと嬉しいです インストールすると 1GB ぐらい、その意味では軽くは無い
他って言うと、
・ASICベンダ推奨ツール類 （高価）
（新車買うより遥かに高額だし、そもそも個人相手に売ってくれるのか？)
....
になるから、選択肢は多くは無い >>149
Active-HDL なら軽並みに安いよ。 Altera版フリーのmodelsimが、単独でインストールできるから楽
verilogなら（フリーじゃないけど） veritak とりあえず以下2件ダウンロード中なのですが、どちらもサイズが大きいですね…
・Quartus付属のModelSim（あえて少し古めのバージョン）
・Active-HDL学生版
VHDLの学習用に、make一発ですぐ波形まで出せる軽いシミュレータがあるといいなぁ、と思っているのですが、ちょっとくじけそうです
>>152
Verilogならiverilogの方がWindowsでもLinuxでも使えていいと思います 前にも議論があったと思うけど、インストールに1GBはおろか10G,20GBが必要でも
問題になるようなことは考えにくいんだけどな
MS-SurfaceみたいなSSD交換不可なやつをぎりぎり一杯で使ってるとしても
インストール先をUSBドライブにすればいいだけで、それができないようなソフトは
少ないと思うけど どうにかQuartusのModelSimを試すことができました
ダウンロードは重かったですが、起動は軽かったので、いい感じのVHDLの学習環境を作れました
教えてくれた方はありがとうございました ぼくがかんがえたFPGA三大参入障壁
・自分がどの実機を買うべきなのかわかりにくい
・開発環境をインストールするまでが長い
・コンパイル時間が長い FPGAの開発環境は、クラウドベースにふさわしいと思うんだけど
どのメーカーも始めないね どんだけサーバーリソース食うか
恐ろしいんじゃね
C/C++の環境とはそれこそ桁が3〜4つくらい違いそうだ 当然無償とはいかないだろうから時間課金とかで
ハイエンドPCの10分の1くらいの時間で合成・配置配線できたら
需要はありそうなんだけどね
大昔、WebPackでHDL使えるようになる前のほんの一時期
無償で Xilinxがそういうの提供してたような･･･（記憶違いかも） 時代は繰り返すTSSか。w
PC用のHDLベンチとかある?
合成/配置の時間を競うの 合成は たいした事無い
一番時間費やすのはシュミレーション うん、時間かかるから細切れでやってる
シミュレーション >>162
合成三日でインプリ失敗とかむかし大規模FPGAでやってたわ。
今民生品は、小さいのしか使わなくてわけわからん >>166
DSP48をフルに使って45万円したVertex5を4つ使ってとにかく早く動かす。簡単なお仕事で、使用率90%あたりから、タイミングメットしませーん。ウワーン。それを超えるチップ無いでーす 確かに90%超えたあたりからやたら時間かかるよね。
Symplify 使うと多少マシになる。 確かに90%超えたあたりからやたら時間かかるよね。
Symplify 使うと多少マシになる。 配置配線のパラメタチューニングしたりする?
訳もよく判らず弄りすぎで大体元の木阿弥なんだけど チューニングのやり方がわからない（ため息）
Lチカぐらい簡単なやつは10秒でコンパイルできればいいんだけど、最適化を完全オフにするパラメータってあるの？ （回路合成だけでなく）配置配線のツールもサードパーティが開発できればいいのにぃ >>172
開発すればいいんじゃね？
ダメってことはないだろ。 >>173
ちょっとやってみたいけど、NGDやNCDのフォーマットに関する公開資料なくね？ >>174
http://www.clifford.at/icestorm/
Project IceStorm aims at reverse engineering and documenting the bitstream format of Lattice iCE40 FPGAs
Why the Lattice iCE40?
It has a very minimalistic architecture with a very regular structure.
さぁやってくれ。 >>175
やっぱりリバースエンジニアリングになるのか（無茶言わんでくれ）
でもLatticeはノーマークだったから教えてくれてありがとう 正式に開発したいなら教えてくれるかもよ。
NDA いるだろうけど。 FPGAエディタをスクリプト経由で動かすとか
無理か パーソナル・バケーション・アシスタント？（PVA） >>75
>FPGAの回路設計とASICの回路設計は似て非なるもの
ほう、そのこころは？ わからんけど
FPGAはセル単位になってしまうとか？ FPGA だとデュアルポートRAMや演算器を優先的に使う設計するけど
ASIC だとシングルポートRAM、演算は出来るだけ単純化とかかな。
ASIC はプロセスにもよるけど。
それ以上に検証が違うけど。 10年以上前、フルスキャンで故障検出率１００％にしたらテスト部門が喜んでた。
最近のテストはどうなってるのだろう？ バックエンドは良く知らんけど、最近はゲートシミュレーションはやらないな。
故障検出はスキャンパス張るんだろう。 
