【Verilog】記述言語で論理設計Project15 【VHDL】 [無断転載禁止]©2ch.net

**774ワット発電中さん** · 2017/04/21(金) 21:48:16.41

HDLの処理系も、それを実際に動かすシミュレータ・評価基板も、
安価で入手できるようになってきました。

このスレが目に入ったお嬢さん! HDLで何か作って遊んでみませんか。
日曜工作のHDL書き、学生さん、プロの方、主婦の方、カキコお待ちしております。
関連情報は >2-10 あたり。

入れ食いキーワード
・Nios、MicroBraze
・Artix-7、Kintex-7、Virtex-7、ハードコアCPU内蔵 Zynq-7000

※前スレ
【Verilog】記述言語で論理設計Project14 【VHDL】
http://rio2016.2ch.net/test/read.cgi/denki/1470611688/

**774ワット発電中さん** · 2017/04/21(金) 21:48:36.06

・FPGA
　Xilinx　ttp://japan.xilinx.com/
　ALTERA　ttp://www.altera.co.jp/
　Lattice　ttp://www.latticesemi.co.jp/
　Actel　　ttp://www.actel.com/intl/japan/
　QuickLogic　ttp://www.quicklogic.com/

・ASICベンダ推奨ツール類（高価）
　Synopsys　ttp://www.synopsys.co.jp/
　Cadence　ttp://www.cadence.co.jp/
　Mentor　ttp://www.mentorg.co.jp/
　Synplicity　ttp://www.synplicity.jp/

・Verilogシミュレーター（無料）
　Icarus Verilog
　　ttp://iverilog.icarus.com/
　　ttp://ryusai-hp.web.infoseek.co.jp/icarus.htm　(解説)
　　ttp://www.ice.gunma-ct.ac.jp/~kimsyn/verilog/FreeSim/iverilog/iverilog.html　(解説)
　IVI
　　ttp://ivi.sourceforge.net/
　　ttp://www.kumikomi.net/archives/2005/06/10icarus.php　(解説)

・VCDフォーマットの波形表示（無料）
　GTKWave
　　ttp://gtkwave.sourceforge.net/
　　ttp://ryusai-hp.web.infoseek.co.jp/gtkwave.htm　(解説)

・関連書籍
　STARC　ttp://www.starc.jp/
　CQ出版　ttp://www.cqpub.co.jp/
　Interface　ttp://interface.cqpub.co.jp/
　Design Wave Magazine (休刊)　ttp://www.cqpub.co.jp/dwm/
　ディジタル・デザイン・テクノロジ (旧DWM)　ttp://digital-design.cqpub.co.jp/

・解説サイト
　やるおと学ぶ Verilog-HDL　ttp://hirokinakaharaoboe.net/yaruo_verilog/

・関連スレ
　【FPGA/CPLD】 XILINX/ALTERA/Lattice/Actel #24
　　　　　　http://rio2016.2ch.net/test/read.cgi/denki/1475205631/
　【EP3】DE0で始めるVerilog HDL【C16】
　　　　　　http://rio2016.2ch.net/test/read.cgi/denki/1310362001/

**774ワット発電中さん** · 2017/04/22(土) 07:13:33.38

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**774ワット発電中さん** · 2017/04/22(土) 11:15:54.15

こんにちは、乙

**774ワット発電中さん** · 2017/04/22(土) 11:23:33.38

>>3
てよく見るけどなんなの？

**arisa** ◆QaHT6HayjI · 2017/04/22(土) 11:32:59.43

30umのLSI設計はそろそろ飽きたので、28ナノﾁﾝｺのFPGAに再度挑戦したい

**arisa** ◆QaHT6HayjI · 2017/04/22(土) 11:34:19.40

>>5
新しいハードウェア記述言語。わかりやすく言うとHDLだぉ

**774ワット発電中さん** · 2017/04/22(土) 12:05:18.29

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**774ワット発電中さん** · 2017/04/22(土) 20:17:23.26

V3SっていうVisualStudioのアドインでコーディングしてみようと思うんだけど、使ったことある人いる？

**774ワット発電中さん** · 2017/04/27(木) 18:53:07.21

誰も居ませんよ？

**774ワット発電中さん** · 2017/04/27(木) 20:12:07.56

年度末で切られたんじゃない。

**774ワット発電中さん** · 2017/04/29(土) 00:00:51.13

泣いて派遣を斬る。

**774ワット発電中さん** · 2017/04/29(土) 11:23:33.78

派遣を斬る快感はやめられねえ。

**おなかすいたな** ◆NVKihJxAnGde · 2017/05/05(金) 05:51:45.36

MAX10 4004 の高くて分厚い本が、半導体屋のプロがFPGAを書いた本として読むと非常に良く出来てる。
FPGA 中級者ー上級者からステップアップしたい人にはオヌヌメ

**774ワット発電中さん** · 2017/05/05(金) 09:08:28.46

>>14
2相クロックだし、多分非同期設計だからFPGAへの実装は面倒くさそう。

**おなかすいたな** ◆NVKihJxAnGde · 2017/05/05(金) 18:45:46.93

>>15
単層クロックで、φ1とφ2の4通りをenable扱いにして動くように作り替えればいいだけ。

**774ワット発電中さん** · 2017/05/27(土) 18:00:11.13

>>8
ほかのスレでも時々見るけど、これって２次元バーコードか何かなの？

**774ワット発電中さん** · 2017/05/27(土) 18:09:21.11

>>475
「上市」は一般の辞書には収載されていないが、「じょうし」と読み、
「新製品を市場に投入すること。新製品を売り出すこと」を意味する。
英語で表現すれば「launch」。医薬品業界、自動車業界などを担当するアナリストが多用する言葉だが、
医薬品業界では「承認された新薬を市販すること」の意で使用される。

ということで、いわゆる業界用語（造語）の類なので
知っているからどうこう言う言葉でもないようだ。
中国語とはたまたま同じような意味合いになっただけみたい。

**774ワット発電中さん** · 2017/05/27(土) 18:10:05.28

>>18
ごめん、誤爆した

**774ワット発電中さん** · 2017/05/27(土) 20:57:06.04

>>17
暗号(のつもり)かも

**774ワット発電中さん** · 2017/07/02(日) 03:20:28.80

久しぶりにVerilog1ソースの改造をしました。
モジュール接続を変えるだけなので簡単に思っていましたが、とても手間取り、未だにやっています。
なんでこんなに分かりにくいのか考えてみると、電気回路図のように上下左右に伸びて記述すべきものを、
上から下への1次元で表現するからだと気が付きました。

top階層はブロック図で書いて、ブロックの内部をVerilogモジュールで記述するほうが
分かりやすいと思いますが、みなさん　そんなことは内でしょうか?

**774ワット発電中さん** · 2017/07/02(日) 17:23:12.80

最上位層をスケマティックで書いて、中身をVerilogで・・・ということなら、
PSoCなんかでは昔から普通にやってる。

**774ワット発電中さん** · 2017/07/02(日) 20:49:39.59

ASICなのかな？
FPGAもトップはIPコアを配置してブロック図で配線する。HDLは自動生成されるから楽チンだよ。

**774ワット発電中さん** · 2017/07/02(日) 21:41:09.61

トップってピン(I/O)に実際に繋がる層ってこと？

**774ワット発電中さん** · 2017/07/03(月) 10:09:08.04

3階層くらいまではブロック図で書いてその下がVerilogだな。でも追加とか出ると
Verilogでやってブロック図にフィードバックができなくなって、うやむやで終わり。
結局最後に信頼できるのはHDLだけだな。

**774ワット発電中さん** · 2017/07/03(月) 10:10:44.11

＞２２
PSOCってそんなに沢山ゲートがないだろ。

**774ワット発電中さん** · 2017/07/03(月) 17:41:11.19

>>26
見通しを良くするためだから、規模には関係ないっしょ。

**774ワット発電中さん** · 2017/07/03(月) 19:58:35.59

>>24について私も気になるのですが、どなたかご回答いただけないでしょうか？
>トップという言葉の意味

**774ワット発電中さん** · 2017/07/03(月) 20:09:17.43

>>24
そう。
>>28
ザイリンクスの場合のトップはこんな感じ。
http://i.imgur.com/xBE4F0O.jpg

青い箱はIPコア。中身はHDL。

**774ワット発電中さん** · 2017/07/03(月) 20:50:01.70

>>29
早速のご回答どうもありがとうございます。
また例まで提示いただきイメージがつかめました。
ありがとうございます。

**774ワット発電中さん** · 2017/07/11(火) 04:16:25.34

Spartan6までしか使わないんですが、VivadoでSpartan6はできますか?
上に書かれたブロック図を見たら、ISEからVivadoに乗り換えてもいいな、と思えてきました

**774ワット発電中さん** · 2017/07/11(火) 06:14:42.51

>>31
6はVivadoだけよ
ISEはもう新製品をサポートしてない

**774ワット発電中さん** · 2017/07/11(火) 06:52:02.46

>>32
しばらくXilinxから離れているのだけど、Spartan6はISEではないの？

【Verilog】 記述言語で論理設計Project15 【VHDL】 [無断転載禁止]©2ch.net

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