【FPGA/CPLD】 XILINX/ALTERA/Lattice/Actel #24 [無断転載禁止]©2ch.net
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しかしVerifyできるので書き込みは完了しているはずだ。
とするとPowerONでRamへのロードを失敗するのだろうと思う。接続している外部回路と
なにか関係があるんだろうか? >>2
ラズパイよりも扱いにくいですが、細かい所にも手が届きます 最近PCIバスの制御に興味が湧いてきたんだけど
Byte Enableって活用されてるの?
Byte Enableを使って1バイトだけ転送する使い方をする事はあるんだろうか 前スレの話。BGAに関して。
普通に人が住めるような温度、振動環境ならBGAでも良いだろうが、工作機械の中で使ったりするような物では駄目。
自動車の走行に関するような所にも駄目じゃないか? FPGAを始めようとしていますが、教えてください。
Xilinxの開発ツールには、
1. ISEデザインスイート
2. Plan Ahead
3. Vivado
の3つがあるようですが、どのように違うのでしょうか?
ISEが古くてVivadoが新しいようですが、Plan Aheadはどの位置にあるのでしょうか。
Plan Aheadは、ダウンロードする場所もわかりません。 >>11
雑に言うとvivadoの前身がplan ahead
iseは更新止まってるので今更覚える必要はない >>12
>今更覚える必要はない
VivadoってSpartanの開発できたっけ? >>13
コマンドラインなら、できるらしい。
Spartan7が出たら「できる」ということになる。
今のvivadoでは、出来ないらしいです。 Plan Ahead を初めて見たとき、それまでのISEの路線とは全く異なる画面絵作りで
ビックリした。たぶんどこかの会社をXilinxが買ったんじゃないかな?
で、Xilinxは もうPlan Aheadは推していないんでしょうか? 前スレの話題だけど
スマホなんかのBGAは小さいから、かかる応力も少ないよ
エンタープライズは筐体に余裕有るから排熱ちゃんとしてるんじゃないかな
電源切らないからヒートサイクルになりにくいのも有りそう
ゲーム機は排熱カツカツでデカイBGAなのが良くないんだろうね 鉛フリーと膨張後の急激な冷却でクラックが起きるのが原因
温度を上げないようにするかゆっくり冷やすか2択 いきなりVivadoだとびっくるするから慣れてもらうために
PlanAheadのGUIの皮をかぶせたらしい とは言っても、Plan aheadでも充分ビックリするGUIだよ。
ISEのときのあの画面は、どこにあるんだろう、って。
しかも、ISEに比べると、シンセシスの時間が長い。 アルテラしか使ったことないのだが、XlinxもCPUは無料の開発ツールでつかえるの
か? 以前は10万くらいのツールを買わないとつかえなかったと思うが、、 Vivadoは最新ツールだし重い
ISEは軽い
でもやっぱりVivadoはtclも使えるし楽だなぁ SDC (SynopsysR Design Constraints) XilinxだとCPUとかも全部無料なの?乗り換えようかな >>26
途中でティックル使って、長〜いパスを入力する根性があればね。
信じられんわ。 >tclなんかどういう用途で使うの?
alteraだとモデルシムでデバッグするときに使う。 そりゃASICやったこと無い人からしたら、tclなんてそこまで・・・と思うかも知れないけど
Vivadoは制約ファイルがSDC準処な訳で、出来なきゃ話にならんわ 前スレで出てた森岡さんの本持ってたわ
カバーがないけどw
でかい会社に行けば個人本棚で寝てるやつがいっぱいありそうだな 教えてください。
XilinxのISE 14.7 をインストールしたのですが、iMPACTが起動できません。
これまではISEの小窓からiMPACTをダブルクリックすれば、外部窓として起動したのですが、
今回は「_impact4.exeの起動に失敗しました」というメッセージが出てしまいます。
\ISE_DS\ISE\bin\nt (32bit用)だと起動するのですが、nt64だとダメです。
何か私が勘違いしているでしょうか。
よろしくお願いします。
Windows7 pro 64bitです。 とうとうx86にまで至ったか。
The ao486 is an x86 compatible Verilog core implementing all features of a 486 SX.??
https://opencores.org/project,ao486 森岡さんの本を何年か前に購入したけど、
初心者すぎてまだちゃんと読めるレベルに達してないです。
自習だとなかなかきびしいなあ。 >>39
代理店の、初心者向け無料セミナーを受講するのが早道かも bemicro max10はもう生産しないんかねぇ… >>41
10年後も言ってそう
MAX10のボードなんて高くないんだからさっさと買って物作りすりゃいいのに
安いボード買って積むのが趣味なんだろうけど Xilinx 9500って、なんであんなに電気食うの? MAX3000Aもクロック入れても入れなくても殆ど消費変わらなかったな
漏れ電流がほとんどなんだろうね 未使用部分は動的に回路から切り離して使用時に再接続とかCPUでやってるようなことを
将来はこっちも実装させられるのかな?
(切り離した部分にFPGAが電源供給切ってくれるようになること前提で) やっぱIGLOO2は消える運命かい?
ラティスのXP2とモロ競合してるんだが。 >>55
何がいいの?
市場の原理で決まるんじゃね >>56
どっちの見かけ上は同じ。
igloo2はフラッシュで直接スイッチしてるから完全なハード回路と同等に起動
XP2は内蔵フラッシュからSRAMにロードするからシリアルメモリからの起動タイプよりは
早く起動
肝心の能力差は遣ってみなけりゃ判りませんよね。
宇宙線への耐力も違いますよね? なんだよ 6入力のLE 450MHzって
IGLOO2でやっと4入力になったというのに。 原発のサソリ型ロボットってやっぱりFPGAなのかな。火星に行ったのもFPGA搭載だったし放射線に強いとかあるのだろうか。
ビットコインみたく計算ネットワークで相互監視させてエラー排除とかやれば高耐久になりそうだけど中の人はどうやって放射線耐久性を作り出したんだろう。 >>63
集積度高いのは根本的なとこで外部ノイズに弱いから、
現在のノイズ対策技術を施した設計で、昔の集積度低いプロセスで製造して、さらに多数決回路なんかで補完させるとさらに強くなるはず。
で分厚い鉛でカバーしてシールド。
こういうとこだと単機能に特化した低性能のものの方が良いはず。 CPU付のFPGAやってみたいがARMとNIOSならどっちやるべき?
おなじようなものか? > CPU付のFPGA
これなら、ARM以外の選択枝は無いと思うが。
ハードマクロのNIOSなんて あったっけ? 今のご時世NIOSなんぞ覚えても何の役にもたたん
あれはSoCなFPGAがなかった時代の遺物だろう >>63
宇宙線に強いのはアンチフューズだけど。
フラッシュとS-RAMではフラッシュが強いような気もするけど実際どうなの? >>66
ARMはハゲが買収したから死刑フラグでたわけだろ。 今はザイリンクスもZynq推しだし、やっぱりARMじゃないかね Xilinxならただで全部出来るぜ
Altera SoCはベアメタルのデバッガは有料 >>68
その昔はXにPowerPCが入ってた事もあるし、その逆でActelはソフトCPUのCortex-M1が使える。
NIOSもSoCより安いから良いもんよ >73
えっ、DEO-NANOって有料ツールがないと開発できないの? DEO-NANO買ってみようかと思ってたが有料ツールがないとFPGA部が触れないのなら
意味ないが、ベアメタルデバッグってどういう意味で使ってるんだろ? >>69
> SoCだと何がいいんだ?
FPGA SoCは意味無いと思う俺。
汎用SoC使って、足りないとこをFPGAにすればいい >>70
フラッシュのが回路自体のソフトエラーは無いから強いよ
FF自体は書き換わるのは同じだろうけど、
回路自体が書き換わらないなら何かしらできるしね
軍用とか航空、宇宙はActelのアンチヒューズが独占してるらしいな >>76
ゴメン、ARMコア入りFPGAの話な
Quartusの無償版ではLinuxターゲットしかデバッグ出来ないって事 Actel・・・もう無いんだがIntel言いたくない人と同じなのかね >>79
コイツ、何言ってんだ?
無償版で使えないのは、XiのChipScopeの方だろ >>81
は?最新のvivadoならロジアナも無料だよ そうか?、そりゃ悪かったな
ISEの終了と共にXi使うの止めたから、最新の状況は知らん
んで、>> Quartusの無償版ではLinuxターゲットしかデバッグ出来ない
これは、どういう意味だ。 >83
Linuxまで触るつもりはないが、FPGAの書き換えができないと意味ない。できるだろ。
それができるんなら、NIOSを載せてARMとも連携できるはずだよな。 >77
5$のラズパイを日本でもそろそろ売り出すらしいが、10$でもいいからMAX10
をのっけてくれんかのーw
だれか中国人をけしかけて、つくらせろよ。全くコンパチ品を作っても芸がないだろ
うにな。 >85
だからさー。ベアメタルってところが意味不明なのよ。具体的に例を挙げてみてよ。
Linuxを載せて、その上にアプリを載せてアプリのデバッグはできるんだろ。
何ができないんだよ。
FPGAの部分はVerilogで書いてデバッグできるんだろ。当然Niosだってのせることは
できるよな。 みたら、有償で当たり前のような かなり特殊なツールじゃねぇか
Xiは同程度の機能が無償なのか?
ありゃ便利だけど
このレベルになると、そもそもツールに無償のなんか求めないし
それでメシ食ってるヤツでも無い限り使わん
DEO-NANO-SOCで遊んでみようか ってレベルなら
余程の事でもない限り、無償のGDBとSignalTapで間に合う
違うか? もう一つ
>Altera SoCのソフトのデバッグはLinuxしか出来ない
これは何を指してるわけ、Windows(ARM判)上で走るソフトの事?
なら、そんなモンMS以外 誰も求めてないだろ
ツールがLinux判しかない、って意味なら そうかも知らん(調べてないけど)
EDA-ツールベンダはLinux対応が基本だからな、 別に不思議じゃない。
もし、この$995のツール必須なら DEO-NANO-SOCなんか誰も買わんよ
だが、ググれば 買って遊んでるヤツはたくさんいる
無くても別に困らないって事だろ ベアメタルのアプリが作れないってこと?
例えばオリジナルのブートローダーが作れない、とか、DRAMいっぱいまでFPGAが使うのでLinuxを走られる場所が無い、
とか、ARMの計算力だけ欲しい、みたいな物が作れないって事になるのかな?
Linux入れるとメモリとかストレージエリアとかそれなりに必要だし。
レジスタ直接アクセスするのにドライバ作ったりmmapみたいな余計なことしたくない、とかもあるか。 >>90
ベアメタルのアプリが作れないのではなく、デバッグ方法が提供されていないという意味かと。
自前でgdb stub作ればデバッグできるはず。 つかARM使ってたらDS-5知らないとかありえるんかね
というレベルのソフトなんだけどな・・・
そんな荒れるような話でもないと思うんだが >>92
Realview なら持ってるけど使えるかな? ARM使ってるがしらないよ。w それに荒れてないと思うが、、、 >>91 サンクス
あ〜なるほど。どこかでバイナリ作って実行はできるんだ。
でもバイナリ流し込むにしてもJTAG公開されてないとSDカードとかに限られないかな?
自前でGDB入れるにしてもJTAG使えないとUART経由とかか・・・
JTAGのサポートとかこの辺がDS-5無償版では制限されてる感じなのかな。
ひょっとしたらスタートアップ周りも自前になるのか。ARM HPCコアのスタートアップ自前でとなると大変そうだ。 >>95
SDカード経由ならできるはず。この場合はu-bootが起動するので、ここで止めてイメージをロードできると思う。、
以前購入を検討したとき、以下のような感じだったはず。
1. USB Blaster互換のJTAG I/F経由アクセスする方法->添付されているDS-5はこの方式、アクセス方法が未公開(?)
2. ARM Core用のJTAG I/F を使う場合 normalな2020 or 10 pinならCortexA-9用のJTAG ICEが使えるはず。ETM対応の38pinbの場合は、それに対応した\iCEが必要。 Zynq で FPGA だけ使おうと思っても勝手に ARM が動き出しちゃうんだよなぁ。
起動してすぐに SLEEP するように出来ないものか? >>96 たびたびサンクス
・ブートストラップとかはu-bootに任せて、自前のアプリだけ実行するのはOK。
けどデバッグ機能はろくに無いのでエイやで実行する感じ。
・SDカード以外のブートは無理
一度SDから立ち上げてオンボードのROMとかに書き込めば出来るかも。
u-bootのソースからHPC固有のブート部分だけ抜き出して、自前のアプリとくっつけるのも出来そうではあるね。
(そこが公開なのか?というのも調べないと…)
けどHPCの設定を変更したい場合、システムレジスタの設定はユーザの責任。標準u-bootのソースそのままは使えない?
Niosみたいに変更を反映したソースを自動生成してくれると良いのだが…というか、それも有償版DS-5の範疇か。
バイメタルアプリ作るなら素直に有償版買った方が早そうですね。 ベアメタルだw
ZynqはFPGAのコンフィグをARMからしかできないから、コンフィグ後に眠らせるしか無いのでは? ■ このスレッドは過去ログ倉庫に格納されています