【FPGA/CPLD】 XILINX/ALTERA/Lattice/Actel #31
レス数が900を超えています。1000を超えると表示できなくなるよ。
>>811
2入力(ホントは現在状態含めて3入力だけど)のFFを考えた時
思いつくのがRS-FFなんだけど
RとSが同時にアクティブになった時どーするか？ってんで
RSそれぞれ優先ってのも考えられるんだけど
出力(現在状態)が反転する様にしとくと、ちょっと機能的にお得 >>814
>NIOS終了の意味が分からない
ライセンスとはどうなってるのだっけか。
再取得とかができなくなるとかだとそれだけで破綻しそう。 うちの窓口からのメールでは毎年更新してるIPのライセンスの更新ができなくなる。よってIPを含んだFPGAのコンパイルができなくなる。
ファームはライセンス無関係で作れるからよいけどFPGAの改造ができない。 有償版のNIOS使ってるやついるんだな
無償版でこと足りるからライセンス買ったことないわ >>820
NIOSVだけになる。 NIOSVはCYCLONE10LPのようなLowコストデバイスには乗らない。 インテル：だまってても売れるから、個人向けは排除すっか儲からねーし
って感じ？ >>826
Intelが売れてるのは日本だけ。
世界的にはXilinx(AMD)が売れているんじゃなかったっけ？ >>826
FPGAの個人向け市場なんて、FPGAメーカーにとっては売上円グラフの針にもならないぐらいでは。 >>830
どこの会社も毎年新入社員というビギナーが誕生するからね。
ファンを増やす努力をしないとシェアを落とす、ハズ
(Marvelとかクローズドな半導体メーカーもあるけど) そうだと思う、ルネサスみたいに車載用にあぐらかいてると
STMとかPICみたいに中華書き込み機械黙認するようなメーカーに
ユーザ持っていかれる、ユーザが就職したときに慣れ親しんだSTMとか使う。 完全な民業で自己責任ならともかくルネサスも車屋も税金突っ込んであの体たらくだからな >>832
知っていると思うけどルネもSakura(だっけ?)な評価ボード出したし、Arduino UNO R4にはルネのマイコン載ってるし。
スレ的には話題になってないけど ルネもForgeFPGAをリリースして FPGA業界に参入。ただ、今マウサーみたら評価ボードの在庫ゼロw おいおい
ともかくあっちこっちの会社を買収しまくってくれたお陰で、車載一辺倒からは脱却しつつある印象 車載用にあぐらをかいていたら、RXを売ってないのではないかと思うが、それはともかく、
学生のときのホビーでほれ込んだチップを就職してからも使い続けるってわけじゃないしね。
(それができるのは新入社員が製品に採用するマイコンを決定できるようなところ)
FPGAでもマイコンでも、たいていの場合は、実務では右も左もわからないヒヨッコに、
元が何が好きだったかに関わらず、その会社やお客さんが使っているチップが叩き込まれて、
数年もしないうちに、そのチップの手練れになる。
もちろん、そのチップが好きになる、というわけではない。ビジネス。
そもそも新入社員の段階で、何かのチップが好き、みたいなベクトル持ってる人ってむしろ珍しいよ。 ベンチャーがポコポコ立ち上がるアメリカでも珍しいのかな
実はガラパゴスだったりしないのかな
>>834
出していることとビジネスの価値は必ずしも相関しない
ってかForgeFPGAってどこで売っているんだ？iCE40LPよりさらに
小規模＆安価なチップとして期待しているんだが >>836
ForgeFPGA、売ってないねぇ～w
半導体不足に巻き込まれて新製品は後回しにされたんだと思ってたけど、それにしては遅いなぁ～ UNO R4の件はルネサスが個人へのアプローチが弱すぎた件の反省の現れやぞ
遅すぎた感があるが ForgeFPGAは略奪婚した嫁の
望んでいない連れ子扱い >>835
どうだろう？
> たいていの場合は、実務では右も左もわからない
その昔は分野違いな部所配属があったなw 俺もやられて転属願い出したわw
しかし人手不足の昨今、定着してもらわないと困るし本人の希望分野や得意分野は配慮してると思う。
今更右も左もの企業、今時あるのか？
もう一つ、それは立派な設計部門を抱えている企業ならそうだろう。
だが設計グループは数人。あとは全部アウトソーシングな会社もあるんだな。
そういうとこは新人意見も通りやすいw >>840
この話はデバイスメーカーにとって影響力のあるユーザとは何かを考えれば、
個人向けは重要でもない、ということなんで。
「もあるんだな」は否定しない。デバイスメーカーにとってこれっぽっちも
重要でなくても、ユーザーから見れば継続的にデバイスが健全に使えるのは
死活問題だし。
それでもメーカーから見れば、大口ユーザーを優先する方が大切だろね。 このスレにGR-SAKURA及び同IIを買った人いる？あの形にRX63Nを搭載されても全く魅力を感じないんだが
RXなら5V対応のRX6xTやRX2xxもしくは最新のRX140あたりにArduinoコネクタを生やした方がした方がまだマシ
rx-gccを積極的に改良し始めたのもここ2～3年だし何もかも後手々かつ場当たり的でやる気を感じられない
国内勢ならソニーセミコンのSpresenseの方がまだやる気があるように見えるよ くさすひとはくさすことが目的なんだね。とりわけ、なにかに取り組みはじめたら「後手」だとか。いちゃもんでしかない。 民業は本来自己責任だ。しかしルネサスは少なからぬ税金が投入されている
納税者は税金を投じた結果が見合っているのか文句を言う権利はあるんじゃないかな
大企業優遇は万国共通だろうけどその大企業は結果を出しているのかな？
ここ数十年日本は低空飛行のままにしか見えないが >>844それは話が全然違う。
税金が投入されていようがいまいが、誰に対する言葉であれ、なにかに取り組みはじめたら「後手」だとか、
いちゃもんでしかないことに変わりはない。クズな行為。
そもそも、FPGAのスレでなんでGR-SAKURAなんだろうな。
それにさ、ここ数年はすげえたくさんの企業が補助金で救われているぞ。 稼がない企業に補助金を突っ込んで延命させているから今みたいな状況になっているんだろ 新規開発ではルネサス使わなくなったな。
Ether とか USB 付きのは Zynq ばっかり。 ってかID:JT25AR1Mは昭和で止まっている人なんか？
取り組むことが重要だとかガラパゴスも甚だしいだろ
民業なら結果を出さずに認められることはないし
そんなのを認めたら競争原理もはたらかなくなってしまう >取り組むことが重要だとかガラパゴスも甚だしいだろ
いやいや。取り組むことが有益なことなら、取り組むことは、取り組まないことよりは重要なのは、今でも変わらないよ。
>民業なら結果を出さずに認められることはないし
あたりまえ。なにごとも取り組まないなら結果も得られないよ。
ぼくが批判しているのは、取り組むことを「後手」と批判することだよ。
今なお望む人が多いであろうことにあらたに取り組むことを「後手」と批判するのは、
過去に取り組まなかった蒸し返しをして、現時点の判断や人、企業の価値を貶めるようなものだ。
企業や組織の中でも、過去の失策のリカバリのために、誰かがあらたに何かに取り組んだときに、
「今さら」「遅いよ」「後手」と批判するクズがいる。こういう行為は害でしかない。
この批判を受けないようにするために、人は、過去の失策のリカバリを自らすすんでしなくなる。
実際のところ、ここでそういうクズが出てきたように、いちゃもんをつけたいだけのクズ発言は必ずといっていいほど発生する。
そのクズ発言を受けるのをのみこんで、リカバリに取り組む行為は批判ではなく賞賛の対象でさえある。
企業が委縮しているのは、企業内外にクズな批判を無責任に発する人がいることと、
そんなのは無視すればいいのに、よりによってマスコミや企業の中にクズ発言を重要視する人がいることも要因だと思う。 せやな
今の日本は足の引っ張り合いで上昇志向が潰された結果と言っても過言ではない 自分が上昇できないときに、他の人の上昇を妨げたり落としたりすれば、相対的に自分が上がったような気になる人が少なからずいるしね。本当に害悪でしかない。 >>844
> 納税者は税金を投じた結果が見合っているのか文句を言う権利はあるんじゃないかな
産業革新機構は2018年と2022年にルネサスの株を売り、2500億の売却益を得た。
公的資金投入と言う税金で2500億儲けてくれたなら、納税者は文句言う筋合いではないな >>851
GR-SAKURAってどれだけ結果を出せたの？何か案件取れた？国内ですらちょろっとみかけたくらいで最近はさっぱりだし
海外での作例ってなにがあるよ
RAなんか作った挙句にArduinoにRAを搭載している時点でRXは予測通りに普及しなかったんだろうけど、その原因の究明と
再発防止が行われているようには見えないよ。初代の問題点を改良した新型を投入しますとかならまだ理解できるが
GR-SAKURAの後継機を出さない時点で「イマイチだったー」→「だよねー」でうやむやにして終わっちゃっているんだろうけど
第一ビジネスで後手に回って競合と同じことしててたら結果は出ない。競合とは違うベクトルで新たな価値を提案するとかしないと RX は H8 や SH の置き換えで、それなりに使われてるけどな。
GR が～言われても評価基板は端から自由度の高い北斗やアルファ使うから知らん。
置き換えは Zynq や ARM にも流れてるからルネサス離れの傾向はあるんやが。 >>855
>ぼくが批判しているのは、取り組むことを「後手」と批判することだよ。
と言ってるのに、GR-SAKURAがー、とか言われても、>>851ではそのことには言及してないよ、としか言いようがない。
>第一ビジネスで後手に回って競合と同じことしててたら結果は出ない。
「すべての場合で後発ビジネスが成功しない」と証明できるわけでもなかろう。根拠もなしに断言してはいけない。
その前にあなたには聞きたいことがある。なぜFPGAスレで、ルネサスのマイコンビジネスの話を持ち出すのか。
GreenPAKの話題を足掛かりにして「ルネサスをくさしたい」というルサンチマンぶりぶりなだけではないのか。 かつて見かけたGR-SAKURAの作例もRXなどのマイコン利用経験者が買ってみたって感じで
他のがじぇるねボードを含めても新規層の開拓に貢献したって感じには見えないんだよな
>>857
>「すべての場合で後発ビジネスが成功しない」と証明できるわけでもなかろう。根拠もなしに断言してはいけない。
大小論を有る無い論にすり替えているよね。それとも博打でも当たればいいみたいな話なのかな？
後発で成功するのは先発を研究し先発の弱点解消できる商品を用意できたケースがほとんどでしょ
それ以外のケースで成功するパターンは歴史的にもほぼないし、相応の先行投資が必要な半導体産業ならなおさらだ
十分な研究や実現性のある計画立案を行わずに成功は掴めないだろ 不十分なマーケティング→市場の需要とずれた商品→予想より売れない→十分に研究された後発の競合他社商品に抜かされる
過剰な品質要求→商品の投入時期が遅れる→先行していた競合他社の商品に対するメリットは品質のみで追い上げすらままならない
みたいなネタは一つや二つじゃないほどある。ID:TilOrMp4みたいな論理整合性を取ろうとしない人が会社の上層部にいるとそうなるんだろうな >>857
GreenPAK(>>790)もSakura(>>834)も書いたのは俺。その人じゃないから誤解しないで >>858は「その前にあなたには聞きたいことがある」が見えないのかな? ルネサス終了スレに行っておいで。
>>860
それは話題としては妥当なんじゃないですかね。それをとっかかりにした人が問題なだけで。 GR-SAKURAはピンク詐欺師が絡んだセミナーでちょこちょこ配布したのがカウントされているだけ。
業界を石鹸するほどインパクトはなかった。いまはOさんが残っているだけ。
全員被害者。勝者ナシで終了。 ｵｵｵｵｫ……(ﾉﾟοﾟ)ﾉﾐ(ﾉ _ _)ﾉｺｹｯ!! >>870
それホント？ずいぶんと業績好調みたいだけど？
https://prtimes.jp/main/html/rd/p/000000067.000009705.html
2023年第2四半期の決算報告で開示されたとおり、インテルのPSG事業部門は前年比35%増となる収益成長率を報告し、3期連続の記録的な売上を達成しています。 AIやるとかいってなかったっけ？
てっきりCPUに入れてくるものかと…… いつもの組み込み系の切り離しかな？
HPC部門は残すのでは？ 海外の企業が企業デザインの観点で、事業の買収や切り離しをすることは
今期の決算の赤黒とは無関係。倒産寸前までできない日本とは違う。
日本は雇用規制があるから、事業の切り離し売却が簡単にできない。
年功序列賃金の水準が売却先の企業と合わなければ(たいてい合わない)
給与水準の調整に十年単位で苦労することになる。
ルネサスが企業買収しているのは、給与の調整が不要な海外企業ばかりだ。 intelさんは高く買って安く売るってのが多くてな…… 「マイコンにちょっと機能追加」みたいな用途だと旧Xilinxや旧Alteraは選択しにくくなった気がする。 >>878
Cyclone10LPで良くね？中身はCycloneIVらしいし >>877
アルテラ買収って聞いた時にそのうちこうなると思ってた
製造は残すってのはちょっと意外だが好きなのを自由に作るのが目的だったんだな FPGA部門は本体から切り離して子会社になるだけっぽいけど
株は過半数持ったままらしいから >>882
いやいや、合成してALTELがいいんじゃね？
一字変えるとActelになるけど🤣 DE0-CVっていつの間にか生産終了してたんだな。
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1.SIMの入ったスマホ・タブレットを用意する
2.以下のTiktok Liteのサイトからアプリをダウンロード（ダウンロードだけでまだ起動しない）
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3.ダウンロード完了後、もう一度上記アドレスのリンクからｱﾌﾟﾘへ
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家族・友人に紹介したり、通常タスクをこなせば更にﾎﾟｲﾝﾄを追加でゲットできます 完全にエスパー話なんですけど、verilogの直接配線wireと疑似直接配線的なregで信号伝達に変化って出ます？
FPGAのmodelsimでのシミュレーションでテストベンチ下のメインモジュール下にモジュールAの1つ目のインスタンス、モジュールAの2つ目のインスタンスがある状態で、
メインモジュールに入力AがあってモジュールAに入力Bがあって、
テストベンチからメインモジュールのAを通ってモジュールA の1つ目のインスタンスの入力Bにそのままつなぐ(wire)場合と
モジュールA の2つ目のインスタンスの入力Bにreg宣言した信号経由でつなぐ(記述的にはalways@* tmpA<=A;だけど本質的にはwire信号みたいに分岐した信号に信号名付けただけのつもり)場合で
両者のモジュールAの出力が変わる(正確には1つ目のインスタンスの方は入力信号が0のままっぽい)だけど原因分かります？
因みにreg宣言信号経由の代入を(tmpAをwire宣言にして)assign tmpA=A;で行うと1つ目のインスタンスと同じ結果になりました。
ポート幅は1ビットで入力宣言している時点でwire宣言省略できますが、一応していて、上位ビットを落としているという話もないです。
ズバリregとwireで違うってのもわかるけど、上記の場合、ただつなげているだけって認識だから差異がるのがわからない。
そもそもなぜこんな話をしたかというと元々そのままつなぐ方法で正常にシミュレーション動いてて、モジュールAの後段の動作でミスがあったから直しているとモジュールA の動作がおかしくなっていて、
そのままつないだ信号が死んでるっぽいことが判明した。(モジュールAは後段の影響は受けない、モジュールA自体は触っていないがテストデータなどは触った)
最初はそのままつないで動いていた、入力信号を下位のモジュールにそのままつなげるなんて他の場所でも過去も含めてよくやっている、正直、そんなことある???って感じで腑に落ちなさ過ぎて
何かしょうもない理由な気がするのですが、検証ではズバリregとwireで動作が変わったという結果だけあるので…
他の場所でもよくやってるって言っているように普通に同じことやっても再現しない気がします。
あとmodelsimで両者のモジュールの入力を見ると同じ信号が入っている。(中身も追えばいいんだけど単純なロジックで同じモジュールをインスタンスしているので、検証時間の都合で見てない) FFじゃないのに<=は何となく気持ち悪い。
文法的にはOKかも知れんが。 >>888-889
申し訳ない。
接続イメージを文書で記述して、後出し情報って言われない為に確認できていること羅列し続けたら長い整理されていない文になった・・・
>>890
ズバリ記述(「assign tmpA=A;」「always@* tmpA<=A;」)していますけど、ラッチ要因ありますか？
前者はそもそもラッチ不可、後者もこのセンシティビティリストで条件分岐無しだとラッチは発生しないと思いますが。
>>887
レーシング・・・あまり詳しくないので調べてみます。ありがとうございます。
でもレーシングってシミュレーションで発生するんですかね。
>>0892
wireをalways文で記述していることではなく、ノンブロッキングで記述していることでしょうか？
まあブロッキングとノンブロッキングを使い分けるほどのことをしないので、always文は基本ノンブロッキングで記述してしまっていますね…。
ザックリというと
・上位モジュールから下位モジュールに信号パスするのにwireではダメだった、reg(実質wire)だといけた。
・そうかregじゃないとダメなのか!!!<=そんな訳ない(主観)
でどうしても納得いかないが、単純な構造過ぎて自分自身では何も思い当たらない(気になるところは前回の文で検証してしまった)ので、
「それ勘違いしてるよ」みたいな話を聞ければと思った次第で。
シミュレーションはあくまでシミュレーションだけど、modelsimで同一モジュール２つインスタンスして入出力ポートの波形出力して入力は同じなのに出力に差異がでるっていうのは・・・自分レベルでは意味分からん・・・
modelsimの不具合かとも思ったけど、流石にそれならネットに情報上がってるだろうし
微妙な例えなのですが「コード修正したのに動作が変わらないんです」とか言ってる人がいて、よくそく見てみると「編集しているコードと実行させているコード、別ファイルだよ」みたいなアホ勘違いをしているのではないのかなっと。
流石にそれではないのですが、記法とか文法とかというよりバカバカしい勘違いをしているような気がするのですが、そこをこの情報からだけで指摘できる人がいればリアルエスパーですが 実機で「assign tmpA=A;」「always@* tmpA<=A;」の違いで動作が変わるのなら
該当部分のスケマかネットリスト比較してみな "assign tmpA = A;"
この文は通常、always ブロック以外で使用される代入文です。これは連続的な代入で、A の値が変更されるたびに、tmpA の値が即座にそれに合わせて更新されます。これは時間の概念に対して敏感ではなく、2つの信号の間に連続的な接続を作成するものです。
"always @ tmpA <= A;"*
この文は、always ブロック内の手続き的な代入の例です。@* の構文は、代入文の右辺のすべての変更に対して感度があることを示しています。<= 演算子はノンブロッキング代入を示し、代入は即座には実行されず、現在のタイムステップ（シミュレーションサイクル）の終わりに実行されるようにスケジュールされます。 伝説の商社マンに報告すると商社になんで質問しないんだと怒りだして質問して2週間解決しないと無能扱いはじめてパワハラがはじまる 上位モジュールでレジスタへのラッチがされていない
それぞれのモジュールでクロックが非同期になっている >>893
出力された波形が見た目同じに見えても同時刻に発生した信号の変化はどっちが先に変化したのかわからないからね～ >>898
前段でクロックに同期していない回路が形成されて現れただけだろうから、おくすり飲んで退職した方がいいよ。 おくすり飲ませて、無能でも自分らで仕事が出来るようなおくすりが出来るといいですね。 >>885
TikTokから見れば4000円は小銭か >>887
メインモジュール入力Aの変化タイミングがクロックのエッジタイミングと同じだと差が出るかもしれない。
下位モジュールの技術に依存するけど。 な、原因は非同期クロックの信号すっぽ抜けだっただろう？ 異なるクロックで動く回路ブロック間でのデータ受け渡しをソツなく設計できるようになれば初心者卒業 platform designerつかって回路作ろうとしてるんだがシミュレーションが動かん、、、 下の方まで見ずに書き込んだけど同じこと言ってて笑った レス数が900を超えています。1000を超えると表示できなくなるよ。
